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Networks On Chips

por Benini, Luca ; Micheli, Giovanni De ; De Micheli, Giovanni

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Formato: Tapa dura (Hardcover)
Editorial: Elsevier Science Ltd
Tema: COMPUTERS / Systems Architecture / General
Tags: Systems on a chip, Computer networks, Equipment and supplies, Networks on a chip, Congresses
Idioma: Inglés
Páginas: 395
Peso: 908 gramos
Estado: Nuevo
ISBN: 0123705215
ISBN 13: 9780123705211
Precio: US$ 116,57
Libro Disponible
Despacho en 7 a 9 días hábiles
Si lo compras hoy, lo recibirás entre el Miércoles 06 de Junio de 2012 y el Viernes 08 de Junio de 2012
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Resumen del libro
Publisher Summary 1
The design of today's semiconductor chips for various applications, such as telecommunications, poses various challenges due to the complexity of these systems. These highly complex systems-on-chips demand new approaches to connect and manage the communication between on-chip processing and storage components and networks on chips (NoCs) provide a powerful solution.

This book is the first to provide a unified overview of NoC technology. It includes in-depth analysis of all the on-chip communication challenges, from physical wiring implementation up to software architecture, and a complete classification of their various Network-on-Chip approaches and solutions.

* Leading-edge research from world-renowned experts in academia and industry with state-of-the-art technology implementations/trends
* An integrated presentation not currently available in any other book
* A thorough introduction to current design methodologies and chips designed with NoCs
 
Publisher Summary 2
The billion-transistor era of application specific semiconductor chips is on the horizon. The design of such chips for various applications, such as telecommunications, poses various challenges due to the complexity of these systems. With advanced semiconductor technologies, below the 65 nanometer node, Systems on Chips can integrate numerous, complex functional units, such as processors and controllers. These highly complex system-on-chips demand new approaches to connect and manage the communication between on-chip processing and storage components. To overcome the limitations of traditional bus-based methods, while maintaining compatibility with existing interface standards and design tool flows, Networks on Chips
(NoCs) provide a powerful solution. Within the NoC paradigm, designers borrow models, techniques, and tools from the network design field and apply them to SoCs design. In other words, a SoC is viewed as a micronetwork of components. The network is the abstraction of the communication among the components and has to satisfy quality of service (QoS) requirements (e.g., reliability, performance, and energy bounds) under the limitation of intrinsic, unreliable signal transmission and nonneglibible communication delays on wires. Whereas complex NoC-based SoCs have been already successfully fabbed and tested (e.g., ST Microelectronics; Arteris), design technologies for NoCs are still in their infancy. This book aims at providing a unified overview of NoC technology.

? Leading-edge research from world-renowned experts in academia and industry with state-of-the-art technology implementations/trends
? An integrated presentation not currently available in any other book
? CD includes NoC software from University of Bologna
 


Tabla de Contenidos del libro
About the Authors ix
List of Contributors
xi
Networks on Chip
1(22)
Why On-Chip, Networking?
2(1)
Technology Trends
3(5)
SoC Objectives and NoC Needs
8(6)
Once Over Lightly
14(5)
Perspectives
19(4)
Network Architecture: Principles and Examples
23(22)
Network Architecture
23(10)
Network Architectures for On-Chip Realization
33(3)
Ad Hoc Network Architectures
36(1)
Component Design for NoCs
37(2)
Properties of Network Architectures
39(2)
Summary
41(4)
Physical Network Layer
45(30)
Interconnection in DSM SoC
47(5)
High-Performance Signaling
52(11)
Building Blocks
63(7)
Summary
70(5)
The Data-Link Layer in NoC Design
75(72)
Tasks of the Data-Link Layer
77(2)
On-Chip Communication Reliability
79(2)
Fault Models for NoCs
81(8)
Principles of Coding Theory
89(17)
The Power-Reliability Trade-Off
106(7)
Unified Coding Framework
113(4)
Adaptive Error Protection
117(4)
Data-Link Layer Architecture: Case-Studies
121(3)
On-Chip Stochastic Communication
124(2)
Link-Level versus End-to-End Error Protection
126(5)
Flow Control
131(4)
Performance Exploration
135(4)
Summary
139(8)
Network and Transport Layers in Network on Chip
147(56)
Network and Transport Layers in NoCs
148(4)
NoC QoS
152(6)
NoC Topology
158(2)
Switching Techniques
160(8)
NoC Addressing and Routing
168(1)
NoC Addressing
168(10)
Congestion Control and Flow Control
178(17)
Summary
195(8)
Network Interface Architecture and Design Issues
203(82)
NI Services
206(4)
NI Structure
210(2)
Evolution of Communication Protocols
212(7)
Point-to-Point Communication Protocols
219(14)
Latest Advances in Processor Interfaces
233(3)
The Packetization Stage
236(14)
End-to-End Flow Control
250(3)
Packet and Circuit Switching
253(4)
NI Architecture: The Aethereal Case Study
257(14)
NI Architecture: The xpipes Case Study
271(6)
NIs for Asynchronous NoCs: The Mango Case Study
277(3)
Summary
280(5)
NoC Programming
285(38)
Architectural Template
287(6)
Task-Level Parallel Programming
293(15)
Communication-Exposed Programming
308(7)
Computer-Aided Software Development Tools
315(4)
Summary
319(4)
Design Methodologies and CAD Tool Flows for NoCs
323(32)
Network Analysis and Simulation
325(6)
Network Synthesis and Optimization
331(2)
Design Flows for NoCs
333(10)
Tool Kits for Designing Bus-Based Interconnect
343(9)
Summary
352(3)
Designs and Implementations of NoC-Based SoCs
355(30)
Kaist Bone Series
355(24)
NoC-Based Experimental Systems
379(3)
Summary
382(3)
Index 385


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